Desarrollo de redes neuronales en FPGA
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cic.lugarDesarrollo | Centro de Técnicas Analógico-Digitales | es |
cic.version | info:eu-repo/semantics/publishedVersion | es |
dc.date.accessioned | 2017-10-23T14:27:20Z | |
dc.date.available | 2017-10-23T14:27:20Z | |
dc.identifier.uri | https://digital.cic.gba.gob.ar/handle/11746/6275 | |
dc.title | Desarrollo de redes neuronales en FPGA | es |
dc.type | Documento de conferencia | es |
dcterms.abstract | Uno de los motivos más importantes del resurgir de las redes neuronales en la década de los ochenta fue el desarrollo de la tecnología microelectrónica de alta escala de integración o VLSI (Very Large Scale Integration), debido a dos circunstancias. Por una parte, posibilitó el desarrollo de computadores potentes y baratos, lo que facilitó la simulación de modelos de redes neuronales artificiales de un relativamente alto nivel de complejidad, permitiendo su aplicación a numerosos problemas prácticos en los que demostraron un excelente comportamiento. Por otra parte, la integración VLSI posibilitó la realización hardware directa de red neuronal, como dispositivos de cálculo paralelo aplicables a problemas computacionalmente costosos, como visión o reconocimiento de patrones. | es |
dcterms.creator.author | Navarría, Leonardo | es |
dcterms.creator.author | Rapallini, José A. | es |
dcterms.creator.author | Quijano, Antonio A. | es |
dcterms.extent | 5 p. | es |
dcterms.isPartOf.issue | XV Iberchip IWS'09 (25 al 27 de marzo de 2009, Buenos Aires) | es |
dcterms.issued | 2009-03 | |
dcterms.language | Español | es |
dcterms.license | Attribution-NonCommercial-ShareAlike 4.0 International (BY-NC-SA 4.0) | es |
dcterms.subject | VLSI | es |
dcterms.subject | redes neuronales | es |
dcterms.subject.materia | Ingeniería de Sistemas y Comunicaciones | es |
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- Nombre:
- 2009_Desarrollo de redes neuronales.pdf-PDFA.pdf
- Tamaño:
- 230.24 KB
- Formato:
- Adobe Portable Document Format
- Descripción:
- Documento completo